module andd(a,b,q); output q ; input a,b; reg q; always @(a,b)if(a==0)if(b==0)q=0; else q=1;endmodule其中，else q=1;与哪句语句对应：
a.always @(a,b)b.if(a==0)c.if(b==0)q=0;d.endmodule正确答案：if(b==0)q=0;
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module andd(a,b,q); output q ; input a,b; reg q; always @(a,b)if(a==0)if(b==0)q=0; else q=1;endmodule其中，else q=1;与哪句语句对应：
a.always @(a,b)b.if(a==0)c.if(b==0)q=0;d.endmodule正确答案：if(b==0)q=0;